Venkatapathi N. Rayapati et Bozena Kaminska
Communication écrite (1994)
Un lien externe est disponible pour ce document
| Renseignements supplémentaires: | Nom historique du département: Département de génie électrique et de génie informatique |
|---|---|
| Département: |
Département de génie électrique Département de génie informatique et génie logiciel |
| URL de PolyPublie: | https://publications.polymtl.ca/32925/ |
| Nom de la conférence: | IEEE International Workshop on Memory Technology, Design, and Testing |
| Lieu de la conférence: | San Jose, Cal, USA |
| Date(s) de la conférence: | 1994-08-08 - 1994-08-09 |
| Maison d'édition: | Institute of Electrical and Electronics Engineers |
| DOI: | 10.1109/mtdt.1994.397200 |
| URL officielle: | https://doi.org/10.1109/mtdt.1994.397200 |
| Date du dépôt: | 18 avr. 2023 15:25 |
| Dernière modification: | 25 sept. 2024 16:15 |
| Citer en APA 7: | Rayapati, V. N., & Kaminska, B. (août 1994). Mega bit CMOS SRAM chip failure analysis using external electrical testing and internal contactless laser beam testing [Communication écrite]. IEEE International Workshop on Memory Technology, Design, and Testing, San Jose, Cal, USA. https://doi.org/10.1109/mtdt.1994.397200 |
|---|---|
Statistiques
Dimensions
Actions réservées au personnel
|
Afficher document |
