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Fast, Scalable, and Flexible C++ Hardware Architectures for Network Data Plane Queuing and Traffic Management

Imad Benacer

Thèse de doctorat (2019)

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Département: Département de génie informatique et génie logiciel
Programme: Génie informatique
Directeurs ou directrices: François-Raymond Boyer et Yvon Savaria
URL de PolyPublie: https://publications.polymtl.ca/3812/
Université/École: Polytechnique Montréal
Date du dépôt: 12 juin 2019 10:59
Dernière modification: 01 avr. 2026 20:27
Citer en APA 7: Benacer, I. (2019). Fast, Scalable, and Flexible C++ Hardware Architectures for Network Data Plane Queuing and Traffic Management [Thèse de doctorat, Polytechnique Montréal]. PolyPublie. https://publications.polymtl.ca/3812/

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