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A novel 10 ps resolution TDC architecture implemented in a 130nm process FPGA

M. Daigneault et Jean Pierre David

Communication écrite (2010)

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Département: Département de génie électrique
Centre de recherche: GR2M - Groupe de recherche en microélectronique et microsystèmes
URL de PolyPublie: https://publications.polymtl.ca/18446/
Nom de la conférence: 8th IEEE International NEWCAS Conference (NEWCAS 2010)
Lieu de la conférence: Montréal, Québec
Date(s) de la conférence: 2010-06-20 - 2010-06-23
Maison d'édition: IEEE
DOI: 10.1109/newcas.2010.5603945
URL officielle: https://doi.org/10.1109/newcas.2010.5603945
Date du dépôt: 18 avr. 2023 15:13
Dernière modification: 25 sept. 2024 15:56
Citer en APA 7: Daigneault, M., & David, J. P. (juin 2010). A novel 10 ps resolution TDC architecture implemented in a 130nm process FPGA [Communication écrite]. 8th IEEE International NEWCAS Conference (NEWCAS 2010), Montréal, Québec. https://doi.org/10.1109/newcas.2010.5603945

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