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Conception et réalisation d'un outil d'exploration architecturale de la hiérarchie de mémoire d'un système sur puce afin d'optimiser la performance de la plateforme logicielle

Sébastien Fontaine

Masters thesis (2008)

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Cite this document: Fontaine, S. (2008). Conception et réalisation d'un outil d'exploration architecturale de la hiérarchie de mémoire d'un système sur puce afin d'optimiser la performance de la plateforme logicielle (Masters thesis, École Polytechnique de Montréal). Retrieved from https://publications.polymtl.ca/8479/
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Abstract

Les systèmes embarqués d'aujourd'hui -- Systèmes sur puce : hiérarchie mémoire, logiciel et optimisation -- Hiérarchie mémoire -- Structure d'un logiciel compilé -- Optimisation de la hiérarchie -- Environnement de simulation space -- Mise à jour de la plateforme de simulation space -- Plateforme microblaze -- Environnement de simulation space -- Mise à jour des composantes -- Outil de traçage d'exécution -- Memoryoptimizer : optimisation de la hiérarchie mémoire -- Flot d'exécution -- Partitionnement de mémoire -- Optimisation de la mémoire cache -- Analyse, performances et discussion -- Méthodologie d'analyse des performances -- Résultats de l'exploration architecturale -- Efficacité des algorithmes de compression de traces -- Extensibilité à d'autres processeurs/plateformes de simulation -- Comparaison avec d'autres travaux -- Rencontre des requis.

Uncontrolled Keywords

Systèmes sur une puce -- Conception assistée par ordinateur; Gestion mémoire (Informatique); Capacité de traitement

Open Access document in PolyPublie
Additional Information: Le fichier PDF de ce document a été produit par Bibliothèque et Archives Canada selon les termes du programme Thèses Canada https://canada.on.worldcat.org/oclc/707816552
Department: Département de génie informatique et génie logiciel
Date Deposited: 04 Aug 2021 11:04
Last Modified: 25 Aug 2021 14:59
PolyPublie URL: https://publications.polymtl.ca/8479/

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