A nonlinear optimization methodology for VLSI fixed-outline floorplanning

Chaomin Luo, Miguel F. Anjos et Anthony Vannelli

Article de revue (2008)

Document publié alors que les auteurs ou autrices n'étaient pas affiliés à Polytechnique Montréal

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URL de PolyPublie:	https://publications.polymtl.ca/38332/
Titre de la revue:	Journal of Combinatorial Optimization (vol. 16, no 4)
Maison d'édition:	Springer
DOI:	10.1007/s10878-008-9148-y
URL officielle:	https://doi.org/10.1007/s10878-008-9148-y
Date du dépôt:	18 avr. 2023 15:16
Dernière modification:	25 sept. 2024 16:22

Citer en APA 7:	Luo, C., Anjos, M. F., & Vannelli, A. (2008). A nonlinear optimization methodology for VLSI fixed-outline floorplanning. Journal of Combinatorial Optimization, 16(4), 378-401. https://doi.org/10.1007/s10878-008-9148-y
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